Vereinigte Staaten
The MITRE Corporation
TSMC
Physical Design Engineer (7452)
Vereinigte Staaten
San Jose, California, United States
Python
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Überblick über die Rolle
Sind Sie ein hochmotivierter und qualifizierter Physical Design Engineer mit mindestens 3 Jahren Industrieerfahrung, der bestrebt ist, die Grenzen der Halbleitertechnologie zu erweitern? Treten Sie unserem dynamischen Test Chip Physical Implementation Team in San Jose, CA, bei und spielen Sie eine entscheidende Rolle bei der Realisierung der fortschrittlichsten Prozessknoten (A16/A14/A10) von TSMC. Dies ist eine spannende Gelegenheit für einen Ingenieur mit einer starken Grundlage im VLSI-Design, einer Leidenschaft für Innovation und praktischer Erfahrung mit modernsten EDA-Tools. Sie werden maßgeblich an der physischen Implementierung und dem Tapeout komplexer Testfahrzeuge beteiligt sein und direkt zur Zukunft von Hochleistungsrechnen und fortschrittlicher Elektronik beitragen.
Verantwortlichkeiten
- Leitung der End-to-End-Physischen Implementierung und des Tapeouts von Testfahrzeugen auf den führenden Prozessknoten (A16/A14/A10) von TSMC.
- Durchführung umfassender Physical Design Flows von Netlist bis GDS, einschließlich:
- Floorplanning auf Block- und SoC-Ebene, Implementierung des Stromversorgungsnetzes und Integration von Low-Power-Strukturen.
- Fortgeschrittene Platzierung, Clock Tree Synthesis (CTS) und Routing für optimale Leistung und Stau-Management.
- Umfassende Designoptimierung für Power-, Performance- und Area-Ziele (PPA).
- Durchführung rigoroser Design-Signoff-Verifizierung, einschließlich:
- RC-Extraktion, Static Timing Analysis (STA), IR/EM-Analyse (IREM), Design Rule Check (DRC), Layout Versus Schematic (LVS), Electrical Rule Check (ERC) und Voltage-Aware Layout Parasitic (VCLP) Analyse.
- Erzielung eines robusten Timing Closures, Physical Design Closures und Power/Signal Integrity Closures basierend auf umfassenden Signoff-Verifizierungsergebnissen.
- Aktive Beteiligung an der Entwicklung und Bewertung fortschrittlicher Methoden und Flows zur Erreichung aggressiver PPA-Ziele.
- Entwicklung und Verbesserung von CAD Automatisierungsskripten und Dashboards unter Verwendung von TCL, Python, CSH und anderen Skriptsprachen zur Optimierung von Design-Flows und zur Sicherstellung der Qualitätsüberwachung.
- Effektive Zusammenarbeit mit funktionsübergreifenden Teams, einschließlich RTL, DFT und CAD, um aufschlussreiches Feedback zu geben und eine nahtlose Integration während des gesamten Designzyklus zu gewährleisten.
Mindestanforderungen
- Master-Abschluss oder höher in Elektrotechnik oder Informatik, mit einem starken akademischen Hintergrund in VLSI-bezogenen Kursen und Projekten.
- Mindestens 3 Jahre Industrieerfahrung im Physical Design oder einem eng verwandten Bereich in der Halbleiterindustrie.
- Nachgewiesene Expertise in digitalen Schaltungskonzepten und ein tiefes Verständnis des vollständigen Physical Design Implementierungs-Flows (automatische Platzierung und Routing, STA, Layout-Design, physische Verifizierung, IREM-Signoff).
- Praktische Erfahrung mit wichtigen EDA-Tools von Synopsys (z. B. ICC2, DC, Primetime, StarRC, ICV) und Cadence (z. B. Innovus, Virtuoso, SimVision).
- Beherrschung von Skriptsprachen wie Python, TCL, CSH, Verilog und Unix-Shell-Skripting.
- Starke analytische und Problemlösungsfähigkeiten mit sorgfältiger Liebe zum Detail.
- Ausgezeichnete schriftliche und mündliche Kommunikationsfähigkeiten mit der Fähigkeit, komplexe technische Konzepte klar zu artikulieren.
- Positiver, kooperativer, selbstmotivierter und anpassungsfähiger Teamplayer, der in der Lage ist, in einem schnelllebigen, vielfältigen kulturellen Umfeld erfolgreich zu sein.
Bevorzugte Qualifikationen
- Vorheriges Praktikum oder Berufserfahrung im Physical Design, Schaltungsdesign oder verwandten Halbleiterbereichen.
- Erfahrung in der Optimierung von Platzierungsstrategien, der Beseitigung von Engpässen und dem Timing-Closure nach der Platzierung.
- Vertrautheit mit Clock Tree Synthesis-Techniken zur Minderung von Latenz und Jitter.
- Kenntnisse von Power Integrity (PI) und Signal Integrity (SI) Closure-Techniken.
- Erfahrung mit Multi-Voltage-Designkonzepten und Low-Power-Techniken.
- Vertrautheit mit anderen EDA-Tools wie Ansys Redhawk oder Synopsys Fusion Compiler.
- DFT-Kenntnisse sind von Vorteil.
Unternehmensbeschreibung
Als vertrauenswürdiger Technologie- und Kapazitätsanbieter wird TSMC von dem Wunsch angetrieben, zu sein:
- Der weltweit führende reine Halbleiter-Foundry
- Der Technologieführer mit einem starken Ruf für Fertigungsexzellenz
- Fortschrittliche Innovationen in der Halbleiterfertigung zur Ermöglichung der Zukunft der Technologie
TSMC hat das Pure-Play-Foundry-Geschäftsmodell, als es 1987 gegründet wurde, eingeführt und ist seitdem die weltweit führende reine Halbleiter-Foundry. Das Unternehmen unterstützt ein florierendes Ökosystem globaler Kunden und Partner mit den branchenführenden Prozesstechnologien und einem Portfolio an Design-Enablement-Lösungen, um Innovationen für die globale Halbleiterindustrie zu entfesseln. Mit globalen Betrieben in Asien, Europa und Nordamerika agiert TSMC weltweit als engagierter Unternehmensbürger.
In Nordamerika verfügt TSMC über eine starke Vertriebs- und Serviceorganisation, die mit Kunden zusammenarbeitet, um ihnen mit modernsten Technologien und Fertigungsexzellenz zum Silizium-Erfolg zu verhelfen. Das Unternehmen hat seine F&E-Investitionen und Personalbesetzung in den letzten Jahren weiter beschleunigt und erweitert seine Produktionskapazitäten, um die Innovationen der Kunden mit 3D IC-Technologien und optimaler Fertigungskapazität zu unterstützen.
Für Positionen, die Zugang zu technischen Daten erfordern, die Exportkontrollbestimmungen unterliegen, einschließlich der Export Administration Regulations, muss TSMC North America möglicherweise eine Exportlizenzgenehmigung von der US-Regierung für bestimmte Personen einholen. Jede Anstellung steht unter dem Vorbehalt, dass TSMC North America die erforderliche Exportlizenz oder andere Genehmigung von der US-Regierung erhält.
Diversitätserklärung
TSMC Technology, Inc. verpflichtet sich zur Beschäftigung einer vielfältigen Belegschaft und bietet allen Personen unabhängig von Rasse, Hautfarbe, Religion, Geschlecht, Alter, nationaler Herkunft, Familienstand, sexueller Orientierung, Geschlechtsidentität, Status als geschützter Veteran, genetischen Informationen oder anderen gesetzlich geschützten Merkmalen gleiche Beschäftigungschancen.
TSMC ist ein Arbeitgeber, der Chancengleichheit fördert und Wert auf Vielfalt und Inklusion legt. Wir verpflichten uns dazu, alle Mitarbeiter und Bewerber mit Respekt und Würde zu behandeln. Wenn Sie aufgrund einer Behinderung während des Bewerbungs- oder Auswahlverfahrens eine angemessene Vorkehrung benötigen, können Sie uns dies gerne unter g_accommodations@tsmc.com [file:///R:/Recruiting/Job%20Requisition%20Documents%20&%20TA%20Resources/TA%20Resources/Job%20Requisition/g_accommodations@tsmc.com] mitteilen.
TSMC bestätigt allen Bewerbern sein Engagement, die Verpflichtungen von TSMC gemäß dem geltenden Arbeitsrecht zu erfüllen. Angemessene Vorkehrungen werden von Fall zu Fall getroffen.
Gehaltstransparenz / Leistungserklärung
Bei TSMC ist Ihr Grundgehalt nur ein Teil Ihres gesamten Vergütungspakets.
Zum Zeitpunkt der Veröffentlichung liegt das typische Grundgehalt für diese Stelle zwischen $110,000 und $160,000 pro Jahr.
Die angezeigte Spanne spiegelt das Minimum und Maximum für neue Mitarbeiter wider. Die tatsächliche Vergütung kann über oder unter der angegebenen Spanne liegen. Faktoren, die die Vergütung beeinflussen, sind die Fähigkeiten, Qualifikationen, Ausbildung, Erfahrung des Einzelnen sowie das Niveau und der Standort der Position.
Das Gesamtvergütungspaket von TSMC besteht aus marktgerechter Vergütung, Zulagen, Boni und umfassenden Leistungen. Wir bieten auch umfangreiche Entwicklungs- und Förderprogramme an.
Mehr Möglichkeiten mit einem Profil
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