Engenheiro Principal de Implantação Avançada de IA

Estados Unidos

Cary, North Carolina, United States · Oregon, United States

Tradução automática. Consulte o original.

Resumo da Função

NA CADENCE, CONTRATAMOS E DESENVOLVEMOS LÍDERES E INOVADORES QUE QUEREM CAUSAR UM IMPACTO NO MUNDO DA TECNOLOGIA.

A Cadence está contratando um Engenheiro Principal de Implantação Avançada de IA para se integrar a clientes estratégicos de semicondutores e operacionalizar as soluções de IA e agentes da Cadence em seus fluxos de design de silício de ponta a ponta. Esta é uma função sênior de IA aplicada voltada para o cliente, para um profissional experiente em design de chips que possa traduzir front-end, design físico e fluxos de metodologia em vitórias concretas e mensuráveis de produtividade, impulsionadas pelos LLMs carro-chefe e pelas ferramentas de IA da Cadence. Você será o líder técnico de confiança no cliente, que transforma 'IA para design de chips' de uma promessa em slides em uma realidade implantada, adotada e com ROI positivo.

Por Que Essa Função Existe

Os clientes estão correndo para aplicar LLMs e IA de agentes em RTL, verificação, implementação e signoff - mas eles precisam de um parceiro que entenda profundamente *tanto* seus fluxos de tape-out quanto como usar sistemas modernos de IA.

Esta função é responsável pelo último quilômetro: pegar os produtos de IA da Cadence (AgentStack, Super-Agents BU, plataforma Cadence.AI / JEDAI, Cerebrus, Verisium, Allegro X AI, etc.) e fazê-los funcionar dentro da metodologia real do cliente, PDKs, malha de computação e limites de segurança.

O sucesso aqui acelera diretamente os tape-outs dos clientes, expande a pegada da IA da Cadence e alimenta os roteiros de produtos com sinais do mundo real.

ESTAMOS FAZENDO UM TRABALHO QUE IMPORTA. AJUDE-NOS A RESOLVER O QUE OUTROS NÃO PODEM.

O Que Você Fará

Implantação Embarcada no Cliente. Liderar a implantação de ponta a ponta de soluções de IA da Cadence / baseadas em LLM nos fluxos de design de silício do cliente - desde o design e verificação de RTL até síntese, place-and-route, timing, energia, signoff e empacotamento.

IA Aplicada para Design de Chips. Arquitetar e ajustar fluxos de agentes, estratégias de prompt, pipelines RAG e padrões de chamada de ferramentas sobre LLMs carro-chefe (Claude, GPT, Gemini, Llama, Qwen, etc.) para automatizar tarefas reais de EDA - triagem de depuração, autoria de restrições, loops de ECO, ajuste de receitas de PD, perguntas e respostas sobre metodologia, resumo de logs/relatórios e copilotos de revisão de design.

Integração de Metodologia e Fluxo. Mapear a metodologia do cliente (design FE, DV, PD, CAD, signoff) nos blocos de construção de IA da Cadence; identificar os pontos de inserção de maior ROI; construir fluxos de referência que a equipe de CAD/metodologia do cliente possa gerenciar a longo prazo.

Propriedade de Produtividade e ROI. Definir e relatar KPIs - redução do tempo de ciclo, horas de engenheiro economizadas, contagem de iterações, sucesso na primeira passagem, eficiência de licença/computação. Ser o responsável pela história, desde o piloto até o lançamento em produção em BUs e sites.

Consultor Técnico de Confiança. Ser a face técnica sênior para fellows do cliente, líderes de metodologia e principais membros da equipe de design. Realizar revisões de design, apresentações técnicas e roteiros conjuntos. Traduzir as dores do cliente em feedback acionável para as equipes de P&D e de plataforma de IA da Cadence.

Habilitação de Sistemas de IA (adicional). Onde necessário, orientar TI/InfoSec do cliente sobre padrões seguros de acesso a LLM, implantação on-premise vs. gateway, roteamento de modelos, registro de prompts/respostas, controles de saída de dados e planejamento de capacidade de GPU/inferência.

Multiplicador de Conhecimento. Capturar playbooks, designs de referência e 'prompts dourados' para que cada implantação se componha. Mentorar AEs de campo, FAEs e campeões de clientes.

Qualificações Essenciais

Bacharelado/Mestrado/Doutorado em Engenharia Elétrica, Engenharia Elétrica e de Computação, Ciência da Computação ou área relacionada.

10+ anos de experiência prática em semicondutores / design de chips em uma ou mais das seguintes áreas: design front-end (RTL, microarquitetura, DV), design físico / implementação (síntese, P&R, timing, energia, signoff), desenvolvimento de CAD / metodologia / fluxo, ou execução de design / liderança técnica de projeto em tape-outs de produção.

Fluência profunda em nível de praticante com fluxos e pontos problemáticos de EDA da indústria - você enviou silício pessoalmente e sabe onde o tempo de ciclo e o tempo do engenheiro realmente são gastos.

Capacidade demonstrada de aplicar ferramentas de LLMs / IA para realizar trabalho de engenharia real (por exemplo, depuração baseada em agentes, assistência na geração de código/RTL, automação via script, copilotos, RAG sobre documentos/logs de design). Não precisa ser seu cargo - tem que ser seu reflexo.

Excelente comunicação voltada para o cliente: igualmente credível com um engenheiro de RTL sênior, um líder de metodologia de PD e um líder de CAD / habilitação de design.

Viés para ação, propriedade e entrega. Confortável em ser o único ponto de contato para uma implantação de IA voltada para o cliente.

Residente ou disposto a se mudar para Portland, OR; capaz de estar no local em instalações de clientes conforme o engajamento exigir.

Desejável / Bônus

Experiência anterior como usuário avançado, AE ou arquiteto de metodologia da Cadence / Synopsys / Siemens EDA. *

Experiência prática com pelo menos um framework de agente (Claude Code, Cursor, LangGraph, AutoGen, pilhas personalizadas de MCP/chamada de ferramentas) aplicado a fluxos de trabalho de engenharia. *

Experiência em configurar acesso seguro a LLM corporativo (gateways, roteamento de modelos, gerenciamento de chaves, registro de auditoria) para organizações de engenharia.

Familiaridade com infraestrutura de GPU/inferência, vLLM/TGI/Triton, fluxos de trabalho de fine-tuning / LoRA / SLM e harnesses de avaliação para tarefas de código/EDA.

Experiência em programas de silício de baixo consumo, alto desempenho, IA/ML, redes, automotivo ou HPC.

Artefatos públicos - artigos, palestras, OSS ou campeões internos - mostrando IA aplicada em contextos de EDA/silício.

Idiomas

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