Estados Unidos
HEARTLAND BUSINESS SYSTEMS LLC
Meta
Engenheiro ASIC, Performance e Modelagem de Silício de Infraestrutura
Estados Unidos
Sunnyvale, California, United States · Austin, Texas, United States
PythonC++
Tradução automática. Consulte o original.
Sobre a oportunidade
A organização de Engenharia de Silício da Meta está desenvolvendo soluções de silício personalizadas que impulsionam a infraestrutura por trás das cargas de trabalho de IA e data center da Meta em escala.
Como Engenheiro de ASIC especializado em performance e modelagem, você definirá e conduzirá a análise de performance arquitetural, modelagem pré-silício e exploração microarquitetural de ASICs personalizados projetados para a infraestrutura da Meta.
Nesta função, você estabelecerá a metodologia de modelagem de performance e a estratégia de roadmap de silício de longo prazo, trabalhando em parceria com as equipes de arquitetura, design e software para garantir que o silício de infraestrutura da Meta atenda às exigentes metas de throughput, latência e eficiência necessárias em hiperescala.
Responsabilidades
- Definir e ser responsável pela estratégia de modelagem de performance para ASICs de infraestrutura personalizados, incluindo o desenvolvimento de ambientes de simulação de ciclo preciso e nível de transação.
- Conduzir a exploração microarquitetural e a análise de trade-offs entre domínios de computação, subsistema de memória, interconexão e E/S para fundamentar as decisões de arquitetura de silício.
- Desenvolver e validar modelos de performance pré-silício que prevejam com precisão o comportamento pós-silício para cargas de trabalho de data center.
- Estabelecer metodologias de análise de performance, frameworks de benchmarking e técnicas de identificação de gargalos em todo o pipeline de ASIC.
- Colaborar com as equipes de arquitetura, design RTL e design físico para traduzir os requisitos de performance em especificações microarquiteturais implementáveis.
- Trabalhar em parceria com as equipes de software e sistemas para co-otimizar o agendamento de cargas de trabalho, firmware e comportamento de drivers em relação às características de performance do silício.
- Liderar revisões técnicas multifuncionais e comunicar os resultados da modelagem de performance e recomendações arquiteturais para a liderança de engenharia.
- Definir roadmaps de infraestrutura de modelagem de performance de longo prazo, incluindo investimentos em ferramentas, automação e plataformas de simulação.
- Orientar outros engenheiros em técnicas de modelagem de performance, metodologia de simulação e melhores práticas de análise microarquitetural.
- Identificar e resolver lacunas de performance entre o comportamento modelado e o medido no silício por meio de análise estruturada de causa raiz e calibração de modelos.
Qualificações Mínimas
- Bacharelado em Ciência da Computação, Engenharia da Computação, área técnica relevante ou experiência prática equivalente.
- 5+ anos de experiência em modelagem de performance de ASIC, análise microarquitetural ou simulação pré-silício para projetos de silício personalizado ou SoC.
- Proficiência em C++ e Python para o desenvolvimento de modelos de simulação, frameworks de automação e ferramentas de análise de performance.
- Experiência no desenvolvimento de modelos de performance de ciclo preciso ou nível de transação usando C++ e SystemC para sistemas digitais complexos, incluindo processadores, subsistemas de memória ou interconexões de alta velocidade.
- Experiência com análise de performance de cargas de trabalho de data center, aceleradores de IA ou computação de alto desempenho em silício personalizado.
- Experiência na definição de especificações microarquiteturais e na condução de alinhamento multifuncional entre as equipes de arquitetura, RTL e design físico.
Qualificações Preferenciais
- Familiaridade com validação de performance pós-silício e metodologias de correlação entre modelo e hardware.
- Experiência no desenvolvimento de pipelines de automação baseados em Python para orquestração de simulação, testes de regressão e análise de dados de performance.
- Experiência com síntese de alto nível, análise de trade-off de potência-performance-área ou otimização microarquitetural orientada por PPA.
- Experiência na construção ou escalonamento de infraestrutura de modelagem de performance para ASICs de data center de hiperescala, incluindo projetos de rede, armazenamento ou aceleradores de inferência de IA.
- Experiência com linguagens de descrição de hardware (por exemplo, SystemVerilog, VHDL) e ambientes de simulação usados em fluxos de desenvolvimento de ASIC.
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